R10000En 1995, MIPS a lancé le processeur R10000. Ce processeur sous forme d'une seule puce fonctionne à une fréquence plus élevée que le R8000, et possède des caches d'instructions et de données plus grands (32 Ko). C'est un processeur super-scalaire mais son innovation majeure réside dans l'exécution dans le désordre (out-of-order execution). Même avec pipeline mémoire unique et une unité de traitement des flottants (FPU) simple, l'amélioration de l'unité de traitement des entiers, le faible coût et une densité élevée ont fait du R10000 un processeur très intéressant.
NexGenNexGen (Milpitas, Californie) était une société privée de semi-conducteurs qui a conçu des microprocesseurs x86 jusqu'à ce qu'elle ait été achetée par AMD en 1996. NexGen était une a conçu ses puces. Les puces NexGen ont été produites par la division Microelectronics d'IBM. La société était surtout connue pour l'implémentation unique de l'architecture x86 dans ses processeurs.
Multiple instructions on multiple datathumb|Principe du mode MIMD Multiple Instructions multiple data ou MIMD un des quatre modes de fonctionnement défini par la taxonomie de Flynn et désigne les machines multi-processeurs où chaque processeur exécute son code de manière asynchrone et indépendante. Pour assurer la cohérence des données, il est souvent nécessaire de synchroniser les processeurs entre eux, les techniques de synchronisation dépendent de l'organisation de la mémoire.
Registre d'étatLe registre d'état, ou registre de drapeaux, est un ensemble de bits représentant des drapeaux au sein d'un processeur. Le registre RFLAGS est un exemple de registre d'état propre à l'architecture de processeurs x64. Les bits composant le registre d'état sont indépendants les uns des autres, et la valeur de chacun apporte une information supplémentaire quant au résultat d'une opération antérieure. En effet, au cours d'un calcul, le processeur va automatiquement mettre à jour le registre d'état, en plus de fournir le résultat de l'opération.
Alpha 21264The Alpha 21264 is a Digital Equipment Corporation RISC microprocessor launched on 19 October 1998. The 21264 implemented the Alpha instruction set architecture (ISA). The Alpha 21264 is a four-issue superscalar microprocessor with out-of-order execution and speculative execution. It has a peak execution rate of six instructions per cycle and could sustain four instructions per cycle. It has a seven-stage instruction pipeline. At any given stage, the microprocessor could have up to 80 instructions in various stages of execution, surpassing any other contemporary microprocessor.
