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Cette séance de cours couvre le concept de programmation dynamique dans la conception de processeurs, visant à augmenter le parallélisme en exécutant des instructions hors de l'ordre. Il traite de la rupture de la rigidité de la pipeline de base, des stations de réservation, de la renommation des registres et des exceptions de manutention. La séance de cours explique également les risques de données WAW et WAR en ordre et hors ordre, ainsi que l'utilisation d'un tampon de réordre. Il se termine par la mise en place de files d'attentes en magasin de chargement et les avantages tangibles d'un calendrier dynamique en termes de parallélisme au niveau de l'instruction.
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