La microarchitecture Nehalem est une microarchitecture x86 d'Intel, utilisée par les familles Nehalem et Westmere. Elle succède à Core, par rapport à laquelle elle apporte plusieurs changements majeurs, comme l'intégration du contrôleur mémoire et l'utilisation d'un nouveau bus de données système et inter-processeur (QPI). Les déclinaisons Clarkdale intègrent en outre un contrôleur PCI-Express.
Le premier processeur Nehalem a été le Core i7 920 sorti en . La microarchitecture suivante est Sandy Bridge.
Architecture multi-cœur modulaire.
Hyperthreading : chaque cœur peut traiter deux threads simultanément.
3 niveaux de mémoire cache dont deux dédiés à chaque cœur.
Contrôleur mémoire double ou triple canal intégré.
Bus système et inter-processeur QuickPath Interconnect (similaire au bus Hypertransport utilisé par AMD) ou DMI.
Second niveau de prédiction de branchement (second niveau de BTB (Branch Target Buffer))
Stockage des boucles logicielles après décodage (précédemment : avant décodage)
Macro fusion des instructions 64 bits (uniquement valable pour les instructions 32 bits sur le Core2)
Contrôleur graphique intégré (sur certains modèles)
Gestion d'énergie propre à chaque cœur.
Support natif de la virtualisation (selon modèles)
Instructions SSE4.2
L'architecture Nehalem est nativement multicœurs. De plus Intel a annoncé une conception modulaire permettant de proposer des variantes de cette architecture en fonction des divers segments du marché, avec plus ou moins de cœurs, de mémoire cache, de bus système et de contrôleurs mémoires.
La plupart des microprocesseurs modernes intègrent leur contrôleur mémoire, qui permet les échanges directs entre la mémoire vive et le processeur, sans passer par le chipset.
Intel QuickPath Interconnect
Certains modèles sont reliés au système par un bus nommé « QuickPath Interconnect ». Il est relativement similaire dans son principe à l'HyperTransport de son concurrent AMD, afin de fournir une bande passante mémoire optimale tout en éliminant au maximum les goulets d'étranglement.
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Le pont nord (en anglais northbridge) est, avec le pont sud (en anglais southbridge), une des deux puces du jeu de circuits (chipset) d’une carte mère, directement relié au microprocesseur et gérant les périphériques rapides, dont la mémoire. Le pont nord gère des communications entre le microprocesseur et les périphériques rapides tels que : la mémoire vive ; le bus AGP pour carte graphique ; les bus PCI Express pour les périphériques externes rapides dont les cartes graphiques ; le pont sud pour les périphériques lents.
The memory controller is a digital circuit that manages the flow of data going to and from the computer's main memory. A memory controller can be a separate chip or integrated into another chip, such as being placed on the same die or as an integral part of a microprocessor; in the latter case, it is usually called an integrated memory controller (IMC). A memory controller is sometimes also called a memory chip controller (MCC) or a memory controller unit (MCU).
High-performance branch target buffers (BTBs) and the L1I cache are key to high-performance front-end. Modern branch predictors are highly accurate, but with an increase in code footprint in modern-day server workloads, BTB and L1I misses are still frequen ...